TI可编程时钟乘法器抖动性能改善3倍 |
| 时间：2005/10/28 9:20:00 作者： 来源：ic72 浏览人数：1143 |
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德州仪器宣布推出一款时钟乘法器，集成三个片上锁相环(PLL)组件，据称可将现有解决方案的周期抖动降低多达70%。该器件的6个输出中每个输出都可以在电路内或在操作期间针对300MHz以上的任何时钟频率进行编程。TI称，其高灵活性能简化设计过程，节省系统成本，帮助设计人员满足高性能通信应用新标准的要求，如无线基站、电信或数据通信设备。
这三款CDCE706 PLL基于TI的射频(RF) Silicon Germanium工艺开发，可以接受晶振、LVCMOS或差分输入，并可利用单个时钟源产生6个时钟信号。利用片上EEPROM技术，设计人员可以编程并把器件的寄存器设置保存到非易失存储器，这样在上电时就无需再编程。在器件投入系统使用时，设计人员还可以根据需要采用双线SMBus接口对输出进行动态地重新编程。
通过提供低于60psec周期抖动的同时对设计过程进行简化，CDCE706有助于加快产品上市速度。用户只需定义输入／输出频率或分割器(divider)设置，后者可以自动设置PLL参数。
新器件具有灵活的输出设置，如：启用、禁用、低状态、信号反相、0.6～3.3ns的压摆率控制以及2.3～3.6V可变输出电源。另外，该器件的高分辨率 PLL分割器可实现0PPM输出时钟误差。
CDCE706采用3.3V电源，可以在-40～85°C温度范围内工作，采用20引脚超薄紧缩小型封装。目前提供样品，2006年第一季度全面投产，建议零售价为3.60美元(千件批量价格)。同时提供开发套件及编程套件。CDCE706另外还为高销量应用提供出厂编程版本。 |
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